취업 · 모든 회사 / 모든 직무
학사: 지거국 전자공학과 (4.07/4.5) 석사:중경외시 라인 반도체학과 (4.24/4.5) 대외수상 : 3개 (관련직무 아님) 관련 교육이수 (3-4개 정도 idec강좌) 어학 : 토스 ih(140) 자격증 : 컴활 1급 분야는 회로 설계입니다. 계속해서 서류 탈락해서 어떤 점을 보완해야하는 지 알고 싶습니다.
2025.10.22
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한번도 실수한 적이 없었는데 3번이나 확인했는데 이력서를 쓰면서 고등학교를 21년 2월 졸업이라 표기했는데 렉이 걸린건지 제가 놓친건지 25년 2월로 제출했습니다. 사이트로 제출한거라 수정, 삭제가 안되는 상황입니다. 정정메일을 보내야할까요,, 이걸로 떨어질까요? 정정메일을 보내자니 모르고 지나칠수있는걸 제가 더 키운거같아 고민입니다.
활동 기입 란 외에, 활동 내용 란에 “아르바이트(4년)” 이런 식으로 n년, n개월 기간을 추가로 계산해서 작성했습니다. 대내외 활동 중 학부생 인턴을 ’활동기간‘ 기입 란에는 알맞게 기입했는데, ’활동내용‘ 란에 3개월이 아니라 3년으로 잘못 작성한 걸 알았습니다. 인사 팀에 연락 드려서 정정 해야 할까요? 아니면 활동기입 란에는 알맞게 입력 했으니 괜찮을까요? 서합률에 미치는 영향 큰지도 혹시 알 수 있을까요?
안녕하십니까 이번에 공고 올라온 거 보니까 계약직이던데 혹시 재직하시는 분들중에 QC 정규직 전환이 될까요?
한번도 실수한 적이 없었는데 3번이나 확인했는데 이력서를 쓰면서 고등학교를 21년 2월 졸업이라 표기했는데 렉이 걸린건지 제가 놓친건지 25년 2월로 제출했습니다. 사이트로 제출한거라 수정, 삭제가 안되는 상황입니다. 정정메일을 보내야할까요,, 이걸로 떨어질까요? 정정메일을 보내자니 모르고 지나칠수있는걸 제가 더 키운거같아 고민입니다.
활동 기입 란 외에, 활동 내용 란에 “아르바이트(4년)” 이런 식으로 n년, n개월 기간을 추가로 계산해서 작성했습니다. 대내외 활동 중 학부생 인턴을 ’활동기간‘ 기입 란에는 알맞게 기입했는데, ’활동내용‘ 란에 3개월이 아니라 3년으로 잘못 작성한 걸 알았습니다. 인사 팀에 연락 드려서 정정 해야 할까요? 아니면 활동기입 란에는 알맞게 입력 했으니 괜찮을까요? 서합률에 미치는 영향 큰지도 혹시 알 수 있을까요?
안녕하십니까 이번에 공고 올라온 거 보니까 계약직이던데 혹시 재직하시는 분들중에 QC 정규직 전환이 될까요?
답변 6
채택된 답변안녕하세요, 회로설계 멘토 삼코치 입니다:) 질문자분의 이력을 보면 기본적인 학력, 성적, 어학, 교육 이수, 수상 등 전반적으로 ‘기본 스펙’은 충실하게 갖춰져 있는 편입니다. 그런데도 계속해서 회로 설계 직무에서 서류 탈락을 경험하고 계시다면, 문제는 단순한 스펙의 부족이 아니라 지원 직무에 맞는 이력서 및 자기소개서 구성의 방향성, 그리고 실제 회로설계 경험의 부재 또는 약한 표현력에 있을 가능성이 높습니다. 회로 설계 분야는 단순히 전자공학 전공을 했다고 해서 합격시키기보다는, 실제 개발 경험, 툴 사용 능력, 회로 설계/검증/보드제작까지의 전체 흐름에 대한 이해가 이력서나 자소서에서 구체적으로 드러나야 관심을 갖습니다. 예를 들어 회로 설계 직무에서 인사담당자나 실무자가 확인하고 싶어하는 부분은 아래와 같습니다. – 어떤 종류의 회로를 설계해봤는가 (전원 회로, 아날로그 필터, 디지털 I/O 회로 등) – 회로도 작성 경험이 있는가? 사용 툴은 무엇인가? (예: Altium, OrCAD, KiCad 등) – PCB 아트웍도 직접 했는가, 아니면 회로도만 설계했는가? – SPICE 기반 시뮬레이션 경험은 있는가? (예: LTspice, PSpice) – 설계 후 실제로 제작하고, 측정/디버깅한 경험은 있는가? – EMI/EMC, SI/PI, 열설계, 노이즈 대응 등 신뢰성 설계 고려 경험은 있는가? 질문자분께서 IDEC 강좌 3~4개를 들으셨다고 하셨는데, 그 교육에서 회로도 설계 → 시뮬레이션 → PCB 제작 → 측정까지 해본 프로젝트가 있었다면, 그 경험을 단순 나열이 아니라 직무 수행 역량 관점에서 재구성해서 표현해야 합니다. 예를 들어 “Altium Designer를 사용해 DC-DC Buck 컨버터 회로를 설계하고, 4-layer PCB로 구현 후 오실로스코프를 통해 리플 특성 측정까지 수행” 같은 서술이 들어가야 회로설계 직무와 연결됩니다. 또한 석사 전공이 반도체학과라고 하셨는데, 그 안에서 ‘디지털 논리’ 중심인지 ‘아날로그 회로’ 중심인지에 따라 직무 적합도가 달라집니다. 만약 RTL 설계나 Verilog/VHDL 기반의 논리회로 쪽이면 전통적인 보드 기반 회로설계와는 조금 결이 다를 수 있고, 그 부분이 정리가 안 되면 평가자 입장에서는 지원 직무와의 매칭에서 혼선을 느낄 수 있습니다. 대외 수상 실적도 3개나 있으시다고 했지만 직무 연관성이 없다고 하셨는데, 만약 기술적 역량이나 팀 프로젝트 수행력, 문제 해결력 등을 보여줄 수 있는 경험이라면, 직무에 연결될 수 있도록 재구성할 수 있습니다. 예를 들어, “기술적 난제를 해결하고 팀워크를 발휘해 완성도 있는 결과물을 도출한 경험”을 회로설계 직무에서의 협업 역량과 연결하는 방식입니다. 종합적으로 보면, 서류 탈락의 주요 원인은 직무 역량이 실무적 관점에서 드러나지 않는 이력 구성 툴/회로/보드/검증 경험에 대한 구체적 서술 부족 학력/자격/어학 등 형식적인 스펙 중심 서술로 실무 매칭 부족 전공 분야(반도체학과)와 지원 직무(보드 기반 회로설계) 간 연계성 부족 이 네 가지일 가능성이 높습니다. 따라서 지금 가장 필요한 것은 '기술 역량 중심의 이력서 리빌딩'입니다. 보유한 툴 사용 경험, 설계한 회로 유형, 수행한 실험 내용, 직접 제작해본 보드나 디버깅 사례 등을 중심으로 기술 포트폴리오처럼 이력을 재정리하시는 것을 추천드립니다. 더 자세한 회로설계 컨텐츠를 원하신다면 아래 링크 확인해주세요 :) https://linktr.ee/circuit_mentor
채택된 답변멘티님 학력과 성적 수준은 충분히 우수하지만 회로설계 직무에서는 스펙보다 ‘직무 중심 포트폴리오 부족’이 주요 탈락 요인으로 보입니다 최근 대기업들은 회로설계 신입 TO가 매우 제한적이고 IDEC 수강 이력만으로는 실무 역량 검증이 어렵기 때문입니다 실제 합격자들은 개인/랩 프로젝트를 Verilog·SystemVerilog 코딩, Cadence·Vivado 기반 설계 결과물과 함께 포트폴리오로 구성해 제출합니다 또한 자소서에서 “설계 툴 경험을 통한 트러블슈팅”이나 “회로 검증 과정에서의 수치 근거” 등 구체적 표현이 없으면 기술적 신뢰도가 낮게 평가됩니다 따라서 IDEC 강좌 내용을 기반으로 회로 블록 단위 프로젝트 2~3개를 결과 중심으로 정리해 포트폴리오화하고, 자소서는 “언어·툴·검증” 키워드 중심으로 수정하는 것이 핵심 보완 전략입니다 토스·컴활보다 실무 적용력 강조로 방향을 전환해보세요 파이팅입니다!
안녕하세요 후배님, 취업 준비에 수고가 많으십니다. 질문 사항에 대해 답변 드리겠습니다. 지원 직무 분야 논문 관련하여 괄목할 만한 성과를 보완해주시기 바라겠습니다. 석사 졸업자의 경우 학부 졸업자와 달리 연구과제, 졸업논문의 중요성이 상대적으로 훨씬 중요하게 작용합니다. 연구과제, 졸업논문의 SCI 저널 게재 여부 등 연구 분야에서 월등한 성과를 거둘 경우 직무 적합성에 있어 타지원자 대비 보다 우월한 경쟁력을 어필하실 수 있습니다. 연구과제, 졸업논문을 진행하는 차원을 넘어 저명한 논문 저널에서 유의미한 성과를 창출할 수 있도록 노력해주시기 바랍니다. * 대외수상 사항이 있으나 관련 직무가 아닌 측면으로 인해 강점을 살리기는 쉽지 않습니다. 참고하십시오.
안녕하세요 멘티님 반갑습니다. 기아 현직자입니다. 적어주신 이력만 봤을 때에는 어학/직무관련 경험 두가지가 약해보입니다. 추가적으로 자격증 같은 것도 없긴 한데, 그건 그리 중요하다고 생각하지 않습니다. 어학은 단적으로 지원자들을 줄세우는게 가능합니다. 비슷한 이력의 지원자들 사이에서 어학이 우수하면 당연히 빛날 수 밖에 없습니다. 또한 최근 많은 회사들이 직무 적합성을 최우선으로 보고 채용을 진행하고 있습니다. 다른 스팩이 좀 부족해도 직무관련 경험이 많으면 채용을 우선한다는 뜻입니다. 아르바이트든 현장실습이든 인턴이든 직무관련 경험으로 이야기 할 만한 것은 없는지 고민해보시기 바랍니다.
